邏輯門電路指實(shí)現(xiàn)基本和常用邏輯運(yùn)算的電子電路，也是集成電路上的基本組件。簡(jiǎn)單的邏輯門可由晶體管組成，晶體管的組合可以使代表兩種信號(hào)的高低電平在通過(guò)它們之后產(chǎn)生高電平或者低電平的信號(hào)。接下來(lái)，為大家詳細(xì)說(shuō)下邏輯門電路原理和邏輯門電路的主要技術(shù)參數(shù)。

一、邏輯門電路原理

首先考慮兩種極限情況：當(dāng)vI處于邏輯0時(shí)，相應(yīng)的電壓近似為0V；而當(dāng)vI處于邏輯1時(shí)，相應(yīng)的電壓近似為VDD。假設(shè)在兩種情況下N溝道管TN為工作管P溝道管TP為負(fù)載管。但是，由于電路是互補(bǔ)對(duì)稱的，這種假設(shè)可以是任意的，相反的情況亦將導(dǎo)致相同的結(jié)果。左圖分析了當(dāng)vI=VDD時(shí)的工作情況。在TN的輸出特性iD—vDS（vGSN=VDD）(注意vDSN=vO)上，疊加一條負(fù)載線，它是負(fù)載管TP在vSGP=0V時(shí)的輸出特性iD－vSD。由于vSGP曲線幾乎是一條與橫軸重合的水平線。兩條曲線的交點(diǎn)即工作點(diǎn)。顯然，這時(shí)的輸出電壓vOL≈0V（典型值<10mV，而通過(guò)兩管的電流接近于零。這就是說(shuō)，電路的功耗很小（微瓦量級(jí)）左圖分析了另一種極限情況，此時(shí)對(duì)應(yīng)于vI=0V。此時(shí)工作管TN在vGSN=0的情況下運(yùn)用，其輸出特性iD－vDS幾乎與橫軸重合，負(fù)載曲線是負(fù)載管TP在vsGP=VDD時(shí)的輸出特性iD－vDS。由圖可知，工作點(diǎn)決定了VO=VOH≈VDD；通過(guò)兩器件的電流接近零值。可見上述兩種極限情況下的功耗都很低。由此可知，基本CMOS反相器近似于一理想的邏輯單元，其輸出電壓接近于零或+VDD，而功耗幾乎為零。

二、邏輯門電路的主要技術(shù)參數(shù)

1、TTL電路的電源均采用+5V，使用時(shí)，不能將電源與地顛倒接錯(cuò)，也不能接高于5.5V的電源。否則會(huì)損壞器件。

2、電路的輸入端不能直接與高于+5.5V或低于－0.5V的低內(nèi)阻電源連接，因?yàn)榈蛢?nèi)阻電源供給較大電流而燒壞器件。

3、輸出端不允許與電源或地短接，必須通過(guò)電阻與電源連接，以提高輸出電平。

4、插入或拔出集成電路時(shí)，務(wù)必切斷電源，否則會(huì)因電源沖擊而造成永久損壞。

 5、多余輸入端不允許懸空。接地電阻的阻值要求R≤=500。

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