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        [常見問題解答]單點(diǎn)接地 or 多點(diǎn)接地介紹 | 壹芯微[
                                        2022-09-05 20:06
                                        ]
        
                                
        
                                    地的處理在電源完整性中起著至關(guān)重要的一環(huán)，低速電路中，大家對(duì)電源完整性和信號(hào)完整性不是很在意，但是在高速電路中，電源完整性（PI）和信號(hào)完整性（SI）雖說是兩個(gè)不同概念，但卻是相輔相成的關(guān)系，都很重要。本文主要聊一聊電子設(shè)備中接地的一些概念。 接地的含義電子設(shè)備中一般有兩種地，一種叫“大地”，也被稱為安全地，另一種是“系統(tǒng)基準(zhǔn)地”，也被稱為信號(hào)地。“接大地”指的是以地球的電位為基準(zhǔn)（以大地作為零電位），把電子設(shè)備的金屬外殼、電路基準(zhǔn)點(diǎn)
        
                                
        
                                    
                                        http://www.kannic.com/Article/ddjdorddjd_1.html3星
        
                            
        
                        
                            
        
                                
        [常見問題解答]PDN網(wǎng)絡(luò)模型分析介紹 | 壹芯微[
                                        2022-08-31 19:08
                                        ]
        
                                
        
                                    最簡(jiǎn)化模型分析最初的芯片功能相對(duì)來說比較簡(jiǎn)單，運(yùn)行的頻率也比較低，所以也很少出現(xiàn)電源完整性問題。當(dāng)時(shí)的工程師也很少考慮電源完整性相關(guān)的設(shè)計(jì)。我們可以使用下圖所示的PDN網(wǎng)絡(luò)模型來分析早期比較簡(jiǎn)單的芯片。可以看到早期的芯片，并沒有在封裝上設(shè)計(jì)去耦電容。在這個(gè)模型中，die包含寄生電阻R_{die}和寄生電容C_{die}，封裝包含了寄生電感L_{pkg}。同時(shí)PCB上也沒有設(shè)計(jì)去耦電容以及電源平面。這是一個(gè)典型的平行諧振電路，并行諧振電路存在并行諧振點(diǎn)。下圖顯示了從上圖的測(cè)試點(diǎn)看到的阻抗曲線。通過如下公式我們可以計(jì)算
        
                                
        
                                    
                                        http://www.kannic.com/Article/pdnwlmxfxj_1.html3星
        
                            
        
                        
                            
        
                                
        [常見問題解答]采用低ESL電容器實(shí)現(xiàn)低阻抗并減少M(fèi)LCC數(shù)量[
                                        2019-10-11 15:10
                                        ]
        
                                
        
                                    近年來，隨著各類電子系統(tǒng)的高功能和高性能化，IC芯片的消耗電流量越來越大。另一方面，IC的高功能化推動(dòng)了內(nèi)部結(jié)構(gòu)的精細(xì)化，因此IC的耐電壓下降，電源電壓值下降。看近年來的趨勢(shì)，需要減少電壓波動(dòng)，而另一方面，IC消耗電流變化又在增加。因此，需要進(jìn)一步降低另一個(gè)因素——阻抗。本文以TDK公司的技術(shù)注釋（AN）為基礎(chǔ)，介紹通過活用電源完整性（PI）將兩端子MLCC（積層陶瓷貼片電容）改為低ESL產(chǎn)品，以降低電源線路阻抗和減少去耦電容數(shù)量。1. 低電壓/大電流電源線的去耦電容隨著電源電壓值的下降，為
        
                                
        
                                    
                                        http://www.kannic.com/Article/cydesldrqs_1.html3星
        
                            
        
                        
                    
                    
                    
                    
        
                    
        
                    
                    
                    
                    
                
        
            
        
        
        
        
        
            
        
        
        
        
        
        
    
        
    
    
    

        
    
        
        
        
        
        
            
        
                地 址/Address
        
            
        
                工廠地址：安徽省六安市金寨產(chǎn)業(yè)園區(qū)
                
        
                深圳辦事處地址：深圳市福田區(qū)寶華大廈A1428
        
                中山辦事處地址：中山市古鎮(zhèn)長(zhǎng)安燈飾配件城C棟11卡
        
                杭州辦事處：杭州市西湖區(qū)文三西路118號(hào)杭州電子商務(wù)大廈6層B座
        
                電話：13534146615
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